遼寧一批新標(biāo)準(zhǔn)下月起執(zhí)行 包含韓提高城鄉(xiāng)居民最低生活保障等
2022-06-22 09:55:12
時(shí)訊：使用Versal ACAP和EV12AQ600 ADC開始ESIstream串行接口的開發(fā)
2022-06-22 09:55:12 來源: 電子創(chuàng)新網(wǎng)
(資料圖片僅供參考)
在這里您可以找到如何使用基于VCK190 Versal AI核心開發(fā)工具的Versal ACAP ESIstream開發(fā)包加速ESIstream高速串行接口開發(fā)的全部信息。
Versal ACAP ESIstream開發(fā)包可幫助您開始進(jìn)行Versal ACAP和ESIstream串行接口的高速數(shù)據(jù)轉(zhuǎn)換器的開發(fā)。這些高速數(shù)據(jù)轉(zhuǎn)換器包括EV12AQ600 ADC (FPGA ESIstream RX)和EV12DD700 DAC (FPGA ESIstream)等。
關(guān)鍵詞： 串行接口 數(shù)據(jù)轉(zhuǎn)換器
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